System verilog Cadence IUS模拟器选项

System verilog Cadence IUS模拟器选项,system-verilog,modelsim,cadence,questasim,synopsys-vcs,System Verilog,Modelsim,Cadence,Questasim,Synopsys Vcs,NC模拟器中-INcdir和+INcdir+选项之间的区别是什么 下面是Makefile中的示例命令。据我所知,testbench目录是使用-INcdir包含的,源代码文件目录是使用+INcdir+命令包含的 ncvlog -SV -INcdir ../include -INcdir ../src -64bit ../src/top.sv ../src/test.sv; ncelab ncelab.log top +incdir+../../../sv/src +incdir+../../../

NC模拟器中-INcdir和+INcdir+选项之间的区别是什么

下面是Makefile中的示例命令。据我所知,testbench目录是使用-INcdir包含的,源代码文件目录是使用+INcdir+命令包含的

ncvlog -SV -INcdir ../include -INcdir ../src -64bit ../src/top.sv ../src/test.sv;
ncelab ncelab.log top +incdir+../../../sv/src +incdir+../../../sv/include

请帮助我理解这些选项的意义。

它们的含义相同。最初的Verilog模拟器使用
+incdir+
类型的参数来指定包含路径。由于遗留原因,这些选项仍然存在。您会注意到,出于同样的原因,其他工具也提供了
+incdir+

它们的含义相同。最初的Verilog模拟器使用
+incdir+
类型的参数来指定包含路径。由于遗留原因,这些选项仍然存在。你会注意到,出于同样的原因,其他工具也提供了
+incdir+

我同意都铎。实际上,它们的意思是一样的

+incdir+arg替换为ncvlog-incdir arg,与+define+arg替换为ncvlog-define arg的方式相同

在《Cadence NC Verilog模拟器用户指南》中,它被称为“Plus”选项翻译


我同意都铎的观点。实际上,它们的意思是一样的

+incdir+arg替换为ncvlog-incdir arg,与+define+arg替换为ncvlog-define arg的方式相同

在《Cadence NC Verilog模拟器用户指南》中,它被称为“Plus”选项翻译


Testbench文件也是源代码文件。@TudorTimi是的,但Testbench文件不会像BFM或监视器文件那样加密,所以我将它们描述为源文件。Testbench文件也是源代码文件。@TudorTimi是的,但Testbench文件不会像BFM或监视器文件那样加密,所以我将它们描述为源文件。