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Verilog中的有符号数组乘法器

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Verilog中的有符号数组乘法器,verilog,signed,Verilog,Signed,我正在尝试实现8x8有符号乘法。我已经用全加器和半加器实现了无符号数组乘法器。为此，我正在阅读以色列科伦出版的《计算机算术算法》第六章。我知道还有其他算法，但我想以以下方式实现，并寻求帮助以了解电路（5x5有符号阵列乘法器） 在上图中，单元格I由三个正输入组成，因此表示普通FA。另一方面，标有II的单元格有一个负输入和两个正输入。类型II的总和可以在-1到2之间变化。I'有所有负输入，II'有两个负输入和一个正输入 II型电池的算术运算由以下方程式描述，x+y-z=2c-s。然而，正常的FA方

我正在尝试实现8x8有符号乘法。我已经用全加器和半加器实现了无符号数组乘法器。为此，我正在阅读以色列科伦出版的《计算机算术算法》第六章。我知道还有其他算法，但我想以以下方式实现，并寻求帮助以了解电路（5x5有符号阵列乘法器）

在上图中，单元格I由三个正输入组成，因此表示普通FA。另一方面，标有II的单元格有一个负输入和两个正输入。类型II的总和可以在-1到2之间变化。I'有所有负输入，II'有两个负输入和一个正输入

II型电池的算术运算由以下方程式描述，x+y-z=2c-s。然而，正常的FA方程是x+y+z=2c+s

s=（x+y-z）mod 2和c=[（x+y-z）+s]/2的给定值

根据书中所述，I&I’和II&II’在闸门实现方面是相同的

因此，我的问题是：

  • 为什么进位的重量为2英寸x+y-z=2c-s或x+y+z=2c+s
  • 输入-z对FA意味着什么？z的2的补码？2的 z的补码在1位中保持不变。两个负输入的情况如何
  • 布尔表达式应该如何查找s和c
  • 对数组乘法器的流水线有什么建议吗
    • 由于我将在Verilog中实现它，从这个角度进行解释将非常有用。提前感谢。

    此问题属于，是@dave_59 True的副本。我也把它贴在那里了。这有点紧急，我想尽量寻求帮助。这个问题是关于硬件设计的，stackoverflow是一个编码论坛。在开始用Verilog代码描述算法之前，您需要了解算法。@dave_59感谢您的温和提醒。我的问题是为了理解算法，因为这个平台可以从两个角度帮助我，所以我毫不犹豫。我将来会记住这一点。