Vhdl 是否有与Verilog'；s@（*），即自动过程灵敏度列表_Vhdl

Vhdl 是否有与Verilog'；s@（*），即自动过程灵敏度列表

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Vhdl 是否有与Verilog'；s@（*），即自动过程灵敏度列表,vhdl,Vhdl,很容易更新组合过程而忘记更新敏感度列表。在Verilog中引入@（*）是为了说明灵敏度列表是在这个过程中使用的。在VHDL中是否有等价物？我在comp.lang.VHDL中找到。听起来像是VHDL-2008在过程（全部）中增加了通配符敏感度，但工具支持各不相同。如果您还不能使用VHDL-2008，可以自动为您插入正确的敏感度列表。Emacs也可以更新它们。那就是我要去的地方

很容易更新组合过程而忘记更新敏感度列表。在Verilog中引入@（*）是为了说明灵敏度列表是在这个过程中使用的。在VHDL中是否有等价物？

我在comp.lang.VHDL中找到。听起来像是VHDL-2008在

过程（全部）

中增加了通配符敏感度，但工具支持各不相同。

如果您还不能使用VHDL-2008，可以自动为您插入正确的敏感度列表。

Emacs也可以更新它们。那就是我要去的地方