Verilog 插入符号(^)是什么意思?

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插入符号^在Verilog hdl语言中是什么意思?在带有输入a和b以及输出c的verilog公式中,c=a^b是什么意思?

符号实现该函数。 有关Verilog运算符的完整列表,请参阅