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VHDL中的5位约翰逊计数器模拟只打印零

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VHDL中的5位约翰逊计数器模拟只打印零,vhdl,counter,Vhdl,Counter,文件jk_触发器.vhd： IEEE库； 使用IEEE.STD_LOGIC_1164.ALL； 实体JK_触发器是 端口（J、K、clk:STD_逻辑中； Q、 Qn：输出标准（U逻辑）； 终端实体； JK_触发器的结构是 信号当前_状态：标准_逻辑：='0'； 开始 过程（J，K）为 开始 如果J='0'和K='1'，那么 当前状态很抱歉，这是JK触发器中的一个愚蠢错误。以下是它的正确实现： IEEE库； 使用IEEE.STD_LOGIC_1164.ALL； 实体JK_触发器是 端口（J、K、

文件
jk_触发器.vhd
：

IEEE库；
使用IEEE.STD_LOGIC_1164.ALL；
实体JK_触发器是
端口（J、K、clk:STD_逻辑中；
Q、 Qn：输出标准（U逻辑）；
终端实体；
JK_触发器的结构是
信号当前_状态：标准_逻辑：='0'；
开始
过程（J，K）为
开始
如果J='0'和K='1'，那么

当前状态很抱歉，这是JK触发器中的一个愚蠢错误。以下是它的正确实现：


IEEE库；
使用IEEE.STD_LOGIC_1164.ALL；
实体JK_触发器是
端口（J、K、clk:STD_逻辑中；
Q、 Qn：输出标准（U逻辑）；
终端实体；
JK_触发器的结构是
信号当前_状态：标准_逻辑：='0'；
开始
过程（J，K）为
开始
如果J='0'和K='1'，那么
当前状态

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